為了在追求加速嵌入系統(tǒng)開發(fā)及維持其可靠性的同時，又能夠兼顧降低開發(fā)成本，產(chǎn)業(yè)界開始轉(zhuǎn)向可重組的設(shè)計架構(gòu)，這種架構(gòu)能夠適用于未來的任務(wù)要求，并且可以掌握系統(tǒng)失靈的狀況。這些可重組的子系統(tǒng)通常以資源受限的FPGA硬體、或者功能完善、帶有特定DSP的多核心處理系統(tǒng)為基礎(chǔ)。

以FPGAs做為目標(biāo)硬體時，必須使用Verilog或VHDL來開發(fā)，而處理器的開發(fā)則是須透過C/C++。許多演算法與零件，特別是與通訊相關(guān)領(lǐng)域，會同時需要將以處理器為基礎(chǔ)與FPGA為基礎(chǔ)的兩種子系統(tǒng)作為目標(biāo)。
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